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UCC27425

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具有使能功能和反相/同相輸入的 4A/4A 雙通道柵極驅(qū)動器

產(chǎn)品詳情

Number of channels 2 Power switch IGBT, MOSFET Peak output current (A) 4 Input supply voltage (min) (V) 4 Input supply voltage (max) (V) 15 Features Enable pin Operating temperature range (°C) -40 to 105 Rise time (ns) 20 Fall time (ns) 15 Propagation delay time (μs) 0.025 Input threshold CMOS, TTL Channel input logic Inverting, Non-Inverting Input negative voltage (V) 0 Rating Catalog Driver configuration Inverting, Non-Inverting
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HVSSOP (DGN) 8 14.7 mm2 3 x 4.9 PDIP (P) 8 92.5083 mm2 9.81 x 9.43 SOIC (D) 8 29.4 mm2 4.9 x 6
  • 行業(yè)標準引腳
  • 每個驅(qū)動器的使能功能
  • 高電流驅(qū)動能力：±4A
  • 獨特的雙極和 CMOS 真正驅(qū)動輸出級可在 MOSFET 米勒閾值下提供高電流
  • 與電源電壓無關(guān)的 TTL/CMOS 兼容輸入
  • 1.8nF 負載時的上升時間和下降時間典型值分別為 20ns 和 15ns
  • 輸入下降和上升時的典型傳播延遲時間分別為 25ns 和 35ns
  • 4V 至 15V 電源電壓
  • 可以并聯(lián)雙輸出以獲得更高的驅(qū)動電流
  • 采用熱增強型 MSOP PowerPAD? 封裝
  • 額定溫度為 -40°C 至 125°C
  • 行業(yè)標準引腳
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  • 高電流驅(qū)動能力：±4A
  • 獨特的雙極和 CMOS 真正驅(qū)動輸出級可在 MOSFET 米勒閾值下提供高電流
  • 與電源電壓無關(guān)的 TTL/CMOS 兼容輸入
  • 1.8nF 負載時的上升時間和下降時間典型值分別為 20ns 和 15ns
  • 輸入下降和上升時的典型傳播延遲時間分別為 25ns 和 35ns
  • 4V 至 15V 電源電壓
  • 可以并聯(lián)雙輸出以獲得更高的驅(qū)動電流
  • 采用熱增強型 MSOP PowerPAD? 封裝
  • 額定溫度為 -40°C 至 125°C

UCC2742x 系列高速雙路 MOSFET 驅(qū)動器可向容性負載提供大峰值電流。該器件提供了 3 個標準邏輯選項的組合：雙路反相、雙路同相以及一路反相和一路同相。熱增強型 8 引腳 PowerPAD™ MSOP 封裝 (DGN) 大大降低了熱阻以改善長期可靠性。它還采用標準 SOIC-8 (D) 或 PDIP-8 (P) 封裝。

通過使用本身能夠盡可能減少擊穿電流的設(shè)計，這些驅(qū)動器可在 MOSFET 開關(guān)切換期間，在米勒平坦區(qū)域提供最需要的 4A 電流。獨特的雙極和 MOSFET 混合輸出級并聯(lián)，可在低電源電壓下實現(xiàn)高效的拉電流和灌電流。

UCC2742x 提供使能 (ENB) 功能，以更好地控制驅(qū)動器應(yīng)用的運行。在引腳 1 和 8 上實現(xiàn)了 ENBA 和 ENBB，之前這些引腳在業(yè)界通用引腳排列中未使用。它們內(nèi)部上拉至 V DD 電源以實現(xiàn)高電平有效邏輯運行，并且可保持斷開連接狀態(tài)以實現(xiàn)標準運行。

UCC2742x 系列高速雙路 MOSFET 驅(qū)動器可向容性負載提供大峰值電流。該器件提供了 3 個標準邏輯選項的組合：雙路反相、雙路同相以及一路反相和一路同相。熱增強型 8 引腳 PowerPAD™ MSOP 封裝 (DGN) 大大降低了熱阻以改善長期可靠性。它還采用標準 SOIC-8 (D) 或 PDIP-8 (P) 封裝。

通過使用本身能夠盡可能減少擊穿電流的設(shè)計，這些驅(qū)動器可在 MOSFET 開關(guān)切換期間，在米勒平坦區(qū)域提供最需要的 4A 電流。獨特的雙極和 MOSFET 混合輸出級并聯(lián)，可在低電源電壓下實現(xiàn)高效的拉電流和灌電流。

UCC2742x 提供使能 (ENB) 功能，以更好地控制驅(qū)動器應(yīng)用的運行。在引腳 1 和 8 上實現(xiàn)了 ENBA 和 ENBB，之前這些引腳在業(yè)界通用引腳排列中未使用。它們內(nèi)部上拉至 V DD 電源以實現(xiàn)高電平有效邏輯運行，并且可保持斷開連接狀態(tài)以實現(xiàn)標準運行。
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支持的產(chǎn)品和硬件

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產(chǎn)品
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借助?PSpice for TI 的設(shè)計和仿真環(huán)境及其內(nèi)置的模型庫，您可對復(fù)雜的混合信號設(shè)計進行仿真。創(chuàng)建完整的終端設(shè)備設(shè)計和原型解決方案，然后再進行布局和制造，可縮短產(chǎn)品上市時間并降低開發(fā)成本。?

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