SN74HC112

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具有清零和預(yù)設(shè)功能的雙通道 J-K 下降沿觸發(fā)器

產(chǎn)品詳情

Number of channels 2 Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Input type LVTTL/CMOS Output type Push-Pull Clock frequency (MHz) 24 Supply current (max) (μA) 40 IOL (max) (mA) 4 IOH (max) (mA) -4 Features Balanced outputs, Clear, High speed (tpd 10-50ns), Negative edge triggered, Positive input clamp diode, Preset Operating temperature range (°C) -40 to 85 Rating Catalog
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PDIP (N) 16 181.42 mm2 19.3 x 9.4 SOIC (D) 16 59.4 mm2 9.9 x 6
  • 2V 至 6V 的寬工作電壓范圍
  • 輸出可驅(qū)動多達(dá) 10 個 LSTTL 負(fù)載
  • 低功耗,ICC 最大值為 40μA
  • tpd典型值 = 13ns
  • 5V 時,輸出驅(qū)動為 ±4mA
  • 低輸入電流,最大值 1 μA
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  • 低輸入電流,最大值 1 μA

SNx4HC112 器件包含兩個獨立的 J-K 負(fù)邊沿觸發(fā)式觸發(fā)器。預(yù)設(shè) (PRE) 或清零 (CLR) 輸入端的低電平會設(shè)置或復(fù)位輸出,不受其他輸入端的電平的影響。當(dāng) PRE 和 CLR 處于非有效狀態(tài)(高電平)時,滿足設(shè)置時間要求的 J 和 K 輸入端數(shù)據(jù)將在時鐘 (CLK) 脈沖的負(fù)向邊沿傳輸?shù)捷敵龆?。時鐘觸發(fā)在一定電壓電平下發(fā)生,與 CLK 脈沖的下降時間沒有直接關(guān)系。經(jīng)過保持時間間隔后,可以更改 J 和 K 輸入端的數(shù)據(jù)而不影響輸出端的電平。這些多功能觸發(fā)器通過將 J 和 K 連接到高電平來作為切換觸發(fā)器運行。

SNx4HC112 器件包含兩個獨立的 J-K 負(fù)邊沿觸發(fā)式觸發(fā)器。預(yù)設(shè) (PRE) 或清零 (CLR) 輸入端的低電平會設(shè)置或復(fù)位輸出,不受其他輸入端的電平的影響。當(dāng) PRE 和 CLR 處于非有效狀態(tài)(高電平)時,滿足設(shè)置時間要求的 J 和 K 輸入端數(shù)據(jù)將在時鐘 (CLK) 脈沖的負(fù)向邊沿傳輸?shù)捷敵龆恕r鐘觸發(fā)在一定電壓電平下發(fā)生,與 CLK 脈沖的下降時間沒有直接關(guān)系。經(jīng)過保持時間間隔后,可以更改 J 和 K 輸入端的數(shù)據(jù)而不影響輸出端的電平。這些多功能觸發(fā)器通過將 J 和 K 連接到高電平來作為切換觸發(fā)器運行。

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應(yīng)用手冊 SN54/74HCT CMOS Logic Family Applications and Restrictions 1996年 5月 1日
應(yīng)用手冊 Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日
選擇指南 Logic Guide (Rev. AC) PDF | HTML 1994年 6月 1日

設(shè)計和開發(fā)

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評估板

14-24-LOGIC-EVM — 采用 14 引腳至 24 引腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產(chǎn)品通用評估模塊

14-24-LOGIC-EVM 評估模塊 (EVM) 設(shè)計用于支持采用 14 引腳至 24 引腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯器件。

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參考設(shè)計

TIDA-01171 — 交流耦合 RS-485 參考設(shè)計

TIDA-01171 參考設(shè)計可在交流耦合鏈路上實現(xiàn) RS-485 通信,即使在數(shù)據(jù)速率極低的情況下也可實現(xiàn)此用途。? 即使節(jié)點之間存在較大的接地電勢差,此參考設(shè)計也能實現(xiàn)節(jié)點通信。? 采用交流耦合還有助于為收發(fā)器提供總線故障保護(hù),否則總線故障可能會導(dǎo)致高壓電源出現(xiàn)直接短路。
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原理圖: PDF
封裝 引腳 CAD 符號、封裝和 3D 模型
PDIP (N) 16 Ultra Librarian
SOIC (D) 16 Ultra Librarian

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