在 PC 板設(shè)計過程中,需要特別注意許多關(guān)鍵信號連接:
- DAC 模擬輸出信號
- 采樣時鐘
- 串行器/解串器 (JESD204x) 數(shù)據(jù)輸入
- 電源
- 電源和接地策略
在開發(fā)高速 PCB 設(shè)計時,需要考量許多注意事項。如果要進行高速 PCB 設(shè)計,可以參考以下建議和示例圖:
- 盡可能在串行器/解串器輸入上使用松散耦合的 100Ω 差分布線進行布線。這種布線可更大限度地降低角和長度匹配蛇形對線對阻抗的影響。
- 提供足夠的線對間距以更大限度地減少串?dāng)_,尤其是在松散耦合差分布線情況下。當(dāng)無法提供足夠的間距時,緊密耦合的差分布線可用于降低自輻射噪聲或提高相鄰布線的抗噪性。
- 提供足夠的接地平面覆銅間距,更大限度地減少與高速布線的耦合。任何接地平面覆銅都必須有足夠的過孔連接到電路板的主接地平面。請勿使用懸空或接地不良的覆銅。
- 使用平滑的輻射角并避免 45 或 90 度彎曲,以減少模擬和數(shù)字信號布線的所有高速輸入/輸出上的阻抗不匹配。詳情請參考圖 8-24。
- 在元件著陸墊(例如 SMA 連接器、平衡-非平衡變壓器等)上引入所需的任何接地平面開孔,以避免這些位置的阻抗不連續(xù)。在這些著陸墊下方的一個或多個接地平面上進行開孔,以實現(xiàn)焊盤尺寸或?qū)盈B高度,從而實現(xiàn)所需的 50Ω 單端阻抗。詳情請參考圖 8-25 和圖 8-26。
- 避免在基準接地平面中的不平順處附近布線。不平順處包括與電源和信號過孔以及通孔器件引線相關(guān)的接地平面或接地層間隙的切割處。
- 在由布線傳輸?shù)淖畲箢l率 (λ/4) 決定的適當(dāng)間距下,提供與任何高速信號相鄰的對稱接地連接拼接過孔。詳情請參考圖 8-24。
- 當(dāng)高速信號必須使用過孔轉(zhuǎn)換到另一層時,應(yīng)盡可能遠地穿過電路板(最好是從上到下),以更大限度地減少過孔頂部或底部的過孔殘樁。如果層選擇不靈活,請使用背鉆或埋入式盲孔來消除殘樁。在各層之間轉(zhuǎn)換時,務(wù)必使兩個接地過孔(“回路過孔”)靠近關(guān)鍵的高速信號布線過孔放置,就近形成接地回路。詳情請參考圖 8-27 和圖 8-28。
- 請?zhí)貏e注意 JESD204x 數(shù)據(jù)輸入路由和模擬輸出路由之間的潛在耦合。JESD204x 輸入的開關(guān)噪聲可耦合到模擬輸出布線中,并由于 DAC 的高帶寬而顯示為寬帶噪聲。盡可能將串行器/解串器 JESD204x 數(shù)據(jù)輸入從 DAC 輸出布線布置在單獨的層上,以避免噪聲耦合,詳情請參考圖 8-29 和圖 8-30。
- 減小時鐘振幅會降低 DAC 噪聲性能,因此請確保時鐘信號具有足夠的驅(qū)動強度,尤其是對于高頻。為了避免這種情況,如果使用無源平衡-非平衡變壓器來驅(qū)動或連接轉(zhuǎn)換器的采樣時鐘引腳,則應(yīng)使時鐘源靠近 DAC。如果布線長度超過幾英寸,則可能需要在 DAC 采樣時鐘輸入引腳處進行阻抗匹配。
圖 8-31 至圖 8-34 展示了電源平面設(shè)計的示例。
此外,對于所有高速 PCB 設(shè)計,TI 建議遵循以下有關(guān) PCB 制造的一般注意事項:
- 對 PCB 堆疊中的任何關(guān)鍵信號層使用高質(zhì)量電介質(zhì)材料。通常,頂層和底層最關(guān)鍵,更多的電路板公司可以混合使用高質(zhì)量和標(biāo)準質(zhì)量的電介質(zhì),即混合堆疊方式。
- 如有必要,可使用多個電源層為轉(zhuǎn)換器提供可靠的電力輸送系統(tǒng)。
- 在 PCB 內(nèi)使用多個接地、電源、接地層堆棧,以便在 PCB 內(nèi)開發(fā)高頻去耦,建議這些層為 4mil 或更小。
- 使用實心接地平面,不要分割接地平面或?qū)ζ洹伴_槽”,以形成模擬與數(shù)字接地隔柵或分頻器,來避免損害。