SN74HC03

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4-ch, 2-input, 2-V to 6-V 5.2 mA drive strength NAND gate with open-drain outputs

產(chǎn)品詳情

Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Number of channels 4 Inputs per channel 2 IOL (max) (mA) 5.2 IOH (max) (mA) 0 Input type Standard CMOS Output type Open-drain Features High speed (tpd 10- 50ns) Data rate (max) (Mbps) 28 Rating Catalog Operating temperature range (°C) -40 to 85
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PDIP (N) 14 181.42 mm2 19.3 x 9.4 SOIC (D) 14 51.9 mm2 8.65 x 6 SOP (NS) 14 79.56 mm2 10.2 x 7.8 TSSOP (PW) 14 32 mm2 5 x 6.4
  • 寬工作電壓范圍：2V 至 6V
  • 輸出可驅(qū)動(dòng)多達(dá) 10 個(gè)低功耗肖特基晶體管邏輯電路 (LSTTL) 負(fù)載
  • 低功耗，ICC 最大值為 20μA
  • 5V 時(shí)，典型 tpd = 8ns
  • ±4 mA 輸出驅(qū)動(dòng) （在 5V 時(shí)）
  • 低輸入電流，1μA
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  • 低功耗，ICC 最大值為 20μA
  • 5V 時(shí)，典型 tpd = 8ns
  • ±4 mA 輸出驅(qū)動(dòng) （在 5V 時(shí)）
  • 低輸入電流，1μA

該器件包含四個(gè)具有漏極開(kāi)路輸出的獨(dú)立 2 輸入與非門。每個(gè)邏輯門以正邏輯執(zhí)行布爾函數(shù) Y = A ● B。

該器件包含四個(gè)具有漏極開(kāi)路輸出的獨(dú)立 2 輸入與非門。每個(gè)邏輯門以正邏輯執(zhí)行布爾函數(shù) Y = A ● B。
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應(yīng)用手冊(cè) Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日
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設(shè)計(jì)和開(kāi)發(fā)

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評(píng)估板

14-24-LOGIC-EVM — 采用 14 引腳至 24 引腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產(chǎn)品通用評(píng)估模塊

14-24-LOGIC-EVM 評(píng)估模塊 (EVM) 設(shè)計(jì)用于支持采用 14 引腳至 24 引腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯器件。

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仿真模型

SN74HC03 Behavioral SPICE Model

SCLM233.ZIP (6 KB) - PSpice Model
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參考設(shè)計(jì)

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設(shè)計(jì)指南: PDF
原理圖: PDF
封裝 引腳 CAD 符號(hào)、封裝和 3D 模型
PDIP (N) 14 Ultra Librarian
SOIC (D) 14 Ultra Librarian
SOP (NS) 14 Ultra Librarian
TSSOP (PW) 14 Ultra Librarian

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包含信息：
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  • 引腳鍍層/焊球材料
  • MSL 等級(jí)/回流焊峰值溫度
  • MTBF/時(shí)基故障估算
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  • 鑒定摘要
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包含信息：
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