SN74HC03

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4-ch, 2-input, 2-V to 6-V 5.2 mA drive strength NAND gate with open-drain outputs

產(chǎn)品詳情

Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Number of channels 4 Inputs per channel 2 IOL (max) (mA) 5.2 IOH (max) (mA) 0 Input type Standard CMOS Output type Open-drain Features High speed (tpd 10- 50ns) Data rate (max) (Mbps) 28 Rating Catalog Operating temperature range (°C) -40 to 85
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PDIP (N) 14 181.42 mm2 19.3 x 9.4 SOIC (D) 14 51.9 mm2 8.65 x 6 SOP (NS) 14 79.56 mm2 10.2 x 7.8 TSSOP (PW) 14 32 mm2 5 x 6.4
  • 寬工作電壓范圍：2V 至 6V
  • 輸出可驅(qū)動多達 10 個低功耗肖特基晶體管邏輯電路 (LSTTL) 負載
  • 低功耗，ICC 最大值為 20μA
  • 5V 時，典型 tpd = 8ns
  • ±4 mA 輸出驅(qū)動 （在 5V 時）
  • 低輸入電流，1μA
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  • 5V 時，典型 tpd = 8ns
  • ±4 mA 輸出驅(qū)動 （在 5V 時）
  • 低輸入電流，1μA

該器件包含四個具有漏極開路輸出的獨立 2 輸入與非門。每個邏輯門以正邏輯執(zhí)行布爾函數(shù) Y = A ● B。

該器件包含四個具有漏極開路輸出的獨立 2 輸入與非門。每個邏輯門以正邏輯執(zhí)行布爾函數(shù) Y = A ● B。
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技術(shù)文檔

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設(shè)計和開發(fā)

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評估板

14-24-LOGIC-EVM — 采用 14 引腳至 24 引腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產(chǎn)品通用評估模塊

14-24-LOGIC-EVM 評估模塊 (EVM) 設(shè)計用于支持采用 14 引腳至 24 引腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯器件。

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仿真模型

SN74HC03 Behavioral SPICE Model

SCLM233.ZIP (6 KB) - PSpice Model
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參考設(shè)計

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封裝 引腳 CAD 符號、封裝和 3D 模型
PDIP (N) 14 Ultra Librarian
SOIC (D) 14 Ultra Librarian
SOP (NS) 14 Ultra Librarian
TSSOP (PW) 14 Ultra Librarian

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