ADC3443

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四通道、14 位、80MSPS 模數(shù)轉(zhuǎn)換器 (ADC)

產(chǎn)品詳情

Sample rate (max) (Msps) 80 Resolution (Bits) 14 Number of input channels 4 Interface type Serial LVDS Analog input BW (MHz) 540 Features Low Power Rating Catalog Peak-to-peak input voltage range (V) 2 Power consumption (typ) (mW) 288 Architecture Pipeline SNR (dB) 73.2 ENOB (Bits) 11.9 SFDR (dB) 92 Operating temperature range (°C) -40 to 85 Input buffer No
Sample rate (max) (Msps) 80 Resolution (Bits) 14 Number of input channels 4 Interface type Serial LVDS Analog input BW (MHz) 540 Features Low Power Rating Catalog Peak-to-peak input voltage range (V) 2 Power consumption (typ) (mW) 288 Architecture Pipeline SNR (dB) 73.2 ENOB (Bits) 11.9 SFDR (dB) 92 Operating temperature range (°C) -40 to 85 Input buffer No
VQFN (RTQ) 56 64 mm2 8 x 8
  • 四通道
  • 14 位分辨率
  • 單電源：1.8V
  • 串行低壓差分信號 (LVDS) 接口
  • 支持 1 分頻、2 分頻和 4 分頻的靈活輸入時鐘緩沖器
  • fIN = 70MHz 時，信噪比 (SNR) = 72.4dBFS，無雜散動態(tài)范圍 (SFDR) = 87dBc
  • 超低功耗：
    • 125MSPS 時為每通道 98mW
  • 通道隔離：105dB
  • 內(nèi)部抖動和斬波
  • 支持多芯片同步
  • 與 12 位版本器件之間具有引腳到引腳兼容性
  • 封裝：超薄四方扁平無引線 (VQFN)-56 (8mm x 8mm)
  • 四通道
  • 14 位分辨率
  • 單電源：1.8V
  • 串行低壓差分信號 (LVDS) 接口
  • 支持 1 分頻、2 分頻和 4 分頻的靈活輸入時鐘緩沖器
  • fIN = 70MHz 時，信噪比 (SNR) = 72.4dBFS，無雜散動態(tài)范圍 (SFDR) = 87dBc
  • 超低功耗：
    • 125MSPS 時為每通道 98mW
  • 通道隔離：105dB
  • 內(nèi)部抖動和斬波
  • 支持多芯片同步
  • 與 12 位版本器件之間具有引腳到引腳兼容性
  • 封裝：超薄四方扁平無引線 (VQFN)-56 (8mm x 8mm)

ADC344x 器件屬于高線性度、超低功耗、四通道、14 位、25MSPS 至 125MSPS 模數(shù)轉(zhuǎn)換器 (ADC) 系列。此類器件專門設(shè)計用于支持具有寬動態(tài)范圍需求且要求苛刻的高輸入頻率信號。輸入時鐘分頻器可給予系統(tǒng)時鐘架構(gòu)設(shè)計更高的靈活性，同時 SYSREF 輸入可實現(xiàn)整個系統(tǒng)同步。

ADC344x 系列支持串行低壓差分信令 (LVDS)，從而減少接口線路的數(shù)量，實現(xiàn)高系統(tǒng)集成密度。串行 LVDS 接口為雙線制，通過兩個 LVDS 對串行輸出每個 ADC 數(shù)據(jù)。此外，也可提供單線制串行 LVDS 接口。內(nèi)部鎖相環(huán) (PLL) 會將傳入的 ADC 采樣時鐘加倍，以獲得串行輸出各通道的 14 位輸出數(shù)據(jù)時所使用的位時鐘。除了串行數(shù)據(jù)流之外，數(shù)據(jù)幀和位時鐘也作為 LVDS 輸出進(jìn)行傳送。

ADC344x 器件屬于高線性度、超低功耗、四通道、14 位、25MSPS 至 125MSPS 模數(shù)轉(zhuǎn)換器 (ADC) 系列。此類器件專門設(shè)計用于支持具有寬動態(tài)范圍需求且要求苛刻的高輸入頻率信號。輸入時鐘分頻器可給予系統(tǒng)時鐘架構(gòu)設(shè)計更高的靈活性，同時 SYSREF 輸入可實現(xiàn)整個系統(tǒng)同步。

ADC344x 系列支持串行低壓差分信令 (LVDS)，從而減少接口線路的數(shù)量，實現(xiàn)高系統(tǒng)集成密度。串行 LVDS 接口為雙線制，通過兩個 LVDS 對串行輸出每個 ADC 數(shù)據(jù)。此外，也可提供單線制串行 LVDS 接口。內(nèi)部鎖相環(huán) (PLL) 會將傳入的 ADC 采樣時鐘加倍，以獲得串行輸出各通道的 14 位輸出數(shù)據(jù)時所使用的位時鐘。除了串行數(shù)據(jù)流之外，數(shù)據(jù)幀和位時鐘也作為 LVDS 輸出進(jìn)行傳送。
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* 數(shù)據(jù)表 ADC344x 四通道、14 位、25MSPS 至 125MSPS 模數(shù)轉(zhuǎn)換器 數(shù)據(jù)表 (Rev. B) PDF | HTML 英語版 (Rev.B) PDF | HTML 2017年 5月 16日
EVM 用戶指南 ADC3xxxEVM and ADC3xJxxEVM User's Guide (Rev. D) 2018年 8月 24日

設(shè)計和開發(fā)

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仿真模型

ADC3444 IBIS Model

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PSPICE-FOR-TI — PSpice? for TI 設(shè)計和仿真工具

PSpice? for TI 可提供幫助評估模擬電路功能的設(shè)計和仿真環(huán)境。此功能齊全的設(shè)計和仿真套件使用 Cadence? 的模擬分析引擎。PSpice for TI 可免費使用，包括業(yè)內(nèi)超大的模型庫之一，涵蓋我們的模擬和電源產(chǎn)品系列以及精選的模擬行為模型。

借助?PSpice for TI 的設(shè)計和仿真環(huán)境及其內(nèi)置的模型庫，您可對復(fù)雜的混合信號設(shè)計進(jìn)行仿真。創(chuàng)建完整的終端設(shè)備設(shè)計和原型解決方案，然后再進(jìn)行布局和制造，可縮短產(chǎn)品上市時間并降低開發(fā)成本。?

在?PSpice for TI 設(shè)計和仿真工具中，您可以搜索 TI (...)
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  • 引腳鍍層/焊球材料
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