ADC12QJ1600-EP

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具有 JESD204C 接口的增強(qiáng)型四通道、12 位、1.6GSPS ADC

產(chǎn)品詳情

Sample rate (max) (Msps) 1600 Resolution (Bits) 12 Number of input channels 4 Interface type JESD204B, JESD204C Analog input BW (MHz) 6000 Features Ultra High Speed Rating HiRel Enhanced Product Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 1910 Architecture Folding Interpolating SNR (dB) 57.4 ENOB (Bits) 9 SFDR (dB) 64 Operating temperature range (°C) -55 to 125 Input buffer Yes
Sample rate (max) (Msps) 1600 Resolution (Bits) 12 Number of input channels 4 Interface type JESD204B, JESD204C Analog input BW (MHz) 6000 Features Ultra High Speed Rating HiRel Enhanced Product Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 1910 Architecture Folding Interpolating SNR (dB) 57.4 ENOB (Bits) 9 SFDR (dB) 64 Operating temperature range (°C) -55 to 125 Input buffer Yes
FCCSP (ALR) 144 100 mm2 10 x 10
  • 高可靠性增強(qiáng)型產(chǎn)品：
    • 受控基線
    • 同一組裝和測(cè)試場(chǎng)所
    • 同一制造場(chǎng)所
    • -55°C 至 125°C 的溫度范圍
    • 延長(zhǎng)的產(chǎn)品生命周期
    • 延長(zhǎng)的產(chǎn)品變更通知
    • 產(chǎn)品可追溯性
  • ADC 內(nèi)核：
    • 分辨率：12 位
    • 最大采樣率：1.6GSPS
    • 非交錯(cuò)式架構(gòu)
    • 內(nèi)部抖動(dòng)可減少高次諧波
  • 性能規(guī)格 (–1dBFS)：
    • SNR (100MHz)：57.4dBFS
    • ENOB (100MHz)：9.1 位
    • SFDR (100MHz)：64dBc
    • 本底噪聲 (–20dBFS)：-147dBFS
  • 滿(mǎn)量程輸入電壓：800mVPP-DIFF
  • 全功率輸入帶寬：6GHz
  • JESD204C 串行數(shù)據(jù)接口：
    • 總共支持 2 至 8 個(gè)串行器/解串器通道
    • 最大波特率：17.16Gbps
    • 64B/66B 和 8B/10B 編碼模式
    • 子類(lèi) 1 支持確定性延遲
    • 與 JESD204B 接收器兼容
  • 可選的內(nèi)部采樣時(shí)鐘生成
    • 內(nèi)部 PLL 和 VCO (7.2–8.2GHz)
  • SYSREF 窗口可簡(jiǎn)化同步
  • 四個(gè)時(shí)鐘輸出可簡(jiǎn)化系統(tǒng)時(shí)鐘
    • FPGA 或相鄰 ADC 的參考時(shí)鐘
    • 串行器/解串器收發(fā)器的參考時(shí)鐘
  • 脈沖系統(tǒng)的時(shí)間戳輸入和輸出
  • 功耗 (1GSPS)：1.9W
  • 電源：1.1V/1.9V
  • 高可靠性增強(qiáng)型產(chǎn)品：
    • 受控基線
    • 同一組裝和測(cè)試場(chǎng)所
    • 同一制造場(chǎng)所
    • -55°C 至 125°C 的溫度范圍
    • 延長(zhǎng)的產(chǎn)品生命周期
    • 延長(zhǎng)的產(chǎn)品變更通知
    • 產(chǎn)品可追溯性
  • ADC 內(nèi)核：
    • 分辨率：12 位
    • 最大采樣率：1.6GSPS
    • 非交錯(cuò)式架構(gòu)
    • 內(nèi)部抖動(dòng)可減少高次諧波
  • 性能規(guī)格 (–1dBFS)：
    • SNR (100MHz)：57.4dBFS
    • ENOB (100MHz)：9.1 位
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    • 本底噪聲 (–20dBFS)：-147dBFS
  • 滿(mǎn)量程輸入電壓：800mVPP-DIFF
  • 全功率輸入帶寬：6GHz
  • JESD204C 串行數(shù)據(jù)接口：
    • 總共支持 2 至 8 個(gè)串行器/解串器通道
    • 最大波特率：17.16Gbps
    • 64B/66B 和 8B/10B 編碼模式
    • 子類(lèi) 1 支持確定性延遲
    • 與 JESD204B 接收器兼容
  • 可選的內(nèi)部采樣時(shí)鐘生成
    • 內(nèi)部 PLL 和 VCO (7.2–8.2GHz)
  • SYSREF 窗口可簡(jiǎn)化同步
  • 四個(gè)時(shí)鐘輸出可簡(jiǎn)化系統(tǒng)時(shí)鐘
    • FPGA 或相鄰 ADC 的參考時(shí)鐘
    • 串行器/解串器收發(fā)器的參考時(shí)鐘
  • 脈沖系統(tǒng)的時(shí)間戳輸入和輸出
  • 功耗 (1GSPS)：1.9W
  • 電源：1.1V/1.9V

ADC12QJ1600-EP 是一款四通道、12 位、1.6GSPS 模數(shù)轉(zhuǎn)換器 (ADC)。該器件具有低功耗、高采樣率和 12 位分辨率，適合用于各種多通道通信系統(tǒng)。

6GHz 的全功率輸入帶寬 (-3dB) 還支持 L 頻帶和 S 頻帶的直接射頻采樣。

包含許多時(shí)鐘功能以放寬系統(tǒng)硬件要求，例如帶有集成壓控振蕩器 (VCO) 的內(nèi)部鎖相環(huán) (PLL)，用于生成采樣時(shí)鐘。提供了四個(gè)時(shí)鐘輸出，以便對(duì) FPGA 或 ASIC 的邏輯和串行器/解串器進(jìn)行計(jì)時(shí)。為脈沖系統(tǒng)提供了時(shí)間戳輸入和輸出。

JESD204C 串行接口通過(guò)減少印刷電路板 (PCB) 布線量來(lái)減小系統(tǒng)尺寸。接口模式支持 2 至 8 個(gè)通道（雙通道和四通道器件）或 1 至 4 個(gè)通道（單通道器件）和高達(dá) 17.16Gbps 的串行器/解串器波特率，從而使每個(gè)應(yīng)用能夠?qū)崿F(xiàn)最佳配置。

ADC12QJ1600-EP 是一款四通道、12 位、1.6GSPS 模數(shù)轉(zhuǎn)換器 (ADC)。該器件具有低功耗、高采樣率和 12 位分辨率，適合用于各種多通道通信系統(tǒng)。

6GHz 的全功率輸入帶寬 (-3dB) 還支持 L 頻帶和 S 頻帶的直接射頻采樣。

包含許多時(shí)鐘功能以放寬系統(tǒng)硬件要求，例如帶有集成壓控振蕩器 (VCO) 的內(nèi)部鎖相環(huán) (PLL)，用于生成采樣時(shí)鐘。提供了四個(gè)時(shí)鐘輸出，以便對(duì) FPGA 或 ASIC 的邏輯和串行器/解串器進(jìn)行計(jì)時(shí)。為脈沖系統(tǒng)提供了時(shí)間戳輸入和輸出。

JESD204C 串行接口通過(guò)減少印刷電路板 (PCB) 布線量來(lái)減小系統(tǒng)尺寸。接口模式支持 2 至 8 個(gè)通道（雙通道和四通道器件）或 1 至 4 個(gè)通道（單通道器件）和高達(dá) 17.16Gbps 的串行器/解串器波特率，從而使每個(gè)應(yīng)用能夠?qū)崿F(xiàn)最佳配置。
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* 數(shù)據(jù)表 ADC12QJ1600-EP 具有 JESD204C 接口的四通道 1.6GSPS 12 位模數(shù)轉(zhuǎn)換器 (ADC) 數(shù)據(jù)表 (Rev. B) PDF | HTML 英語(yǔ)版 (Rev.B) PDF | HTML 2024年 10月 25日

設(shè)計(jì)和開(kāi)發(fā)

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評(píng)估板

ADC12QJ1600EVM — ADC12QJ1600 具有 JESD204C 接口的四通道 12 位 1.6GSPS ADC 評(píng)估模塊

ADC12QJ1600 評(píng)估模塊 (EVM) 用于評(píng)估 ADC12QJ1600-Q1 系列高速模數(shù)轉(zhuǎn)換器 (ADC)。該 EVM 裝配了 ADC12QJ1600-Q1，后者是一款具有 JESD204B 接口的 12 位四通道 1.6GSPS ADC，可評(píng)估 12 位系列中的所有采樣率和單通道、雙通道和四通道汽車(chē)類(lèi)或工業(yè)級(jí)器件。
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評(píng)估板

TSW12QJ1600EVM — ADC12QJ1600-Q1 8 通道（兩個(gè)同步 4 通道）12 位 1.6GSPS JESD204C 接口 ADC 評(píng)估模塊

TSW12QJ1600 評(píng)估模塊 (EVM) 用于評(píng)估具有不同前端選項(xiàng)的 ADC12QJ1600-Q1 系列高速模數(shù)轉(zhuǎn)換器 (ADC)。該 EVM 裝配了雙通道 ADC12QJ1600-Q1（一個(gè)具有 JESD204B 接口的 12 位四通道 1.6GSPS ADC），可評(píng)估多個(gè) ADC 同步和確定性延遲，并使用各種前端選項(xiàng)（交流耦合變壓器；具有 LMH32401 的直流耦合選項(xiàng)）測(cè)試 ADC 的性能。該設(shè)計(jì)還展示了如何通過(guò)從一個(gè) ADC 到另一個(gè) ADC 菊鏈?zhǔn)竭B接 PLL 基準(zhǔn)輸出（PLLREFO+、PLLREFO-）來(lái)簡(jiǎn)化時(shí)鐘方案，無(wú)需采用 JESD 器件通常需要的時(shí)鐘分配芯片。
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包含信息：
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  • 器件標(biāo)識(shí)
  • 引腳鍍層/焊球材料
  • MSL 等級(jí)/回流焊峰值溫度
  • MTBF/時(shí)基故障估算
  • 材料成分
  • 鑒定摘要
  • 持續(xù)可靠性監(jiān)測(cè)
包含信息：
  • 制造廠地點(diǎn)
  • 封裝廠地點(diǎn)

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